SOI based nanowire single-electron transistors: design, simulation and process development
Link to publisher's homepage at http://www.unimap.edu.my/ ; Open access only applicable for vol. 1; issue 1, 2008.
保存先:
主要な著者: | Uda Hashim, A. Rasmi, Samsudi Sakrani |
---|---|
フォーマット: | 論文 |
言語: | English |
出版事項: |
Universiti Malaysia Perlis
2008
|
主題: | |
オンライン・アクセス: | http://dspace.unimap.edu.my/xmlui/handle/123456789/2383 |
タグ: |
タグ追加
タグなし, このレコードへの初めてのタグを付けませんか!
|
類似資料
-
Design of 100nm single-electron transistor (SET) by 2D TCAD simulation
著者:: Amiza, Rasmi, 等
出版事項: (2009) -
Design and analysis of low power using Sleepy Stack and Zig-Zag technique
著者:: Wan Nurul Liyana Wan Zulkefle
出版事項: (2008) -
Coherent effect on LOCOS and STI technique for 0.18 µm CMOS technology using Taurus Workbench
著者:: Wan Shafie Wan Sulaiman
出版事項: (2008) -
Device Characterization of 0.8-µm CMOS Technology
著者:: Kooh, Roy Jinn Chye
出版事項: (2000) -
Electrical characterization of 0.15µm CMOS Transistor using TSUPREM-4 and MEDICI
著者:: Low Pooi Lam
出版事項: (2008)